reset network update
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@@ -33,6 +33,7 @@ module VX_fp_div #(
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wire stall = ~ready_out && valid_out;
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wire stall = ~ready_out && valid_out;
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wire enable = ~stall;
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wire enable = ~stall;
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`ifndef VERILATOR
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wire [LANES-1:0] fdiv_reset;
|
wire [LANES-1:0] fdiv_reset;
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VX_reset_relay #(
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VX_reset_relay #(
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.DEPTH (LANES > 1),
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.DEPTH (LANES > 1),
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@@ -42,6 +43,7 @@ module VX_fp_div #(
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.reset (reset),
|
.reset (reset),
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.reset_o (fdiv_reset)
|
.reset_o (fdiv_reset)
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);
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);
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`endif
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for (genvar i = 0; i < LANES; i++) begin
|
for (genvar i = 0; i < LANES; i++) begin
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`ifdef VERILATOR
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`ifdef VERILATOR
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@@ -59,7 +61,7 @@ module VX_fp_div #(
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.RESETW (1)
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.RESETW (1)
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) shift_req_dpi (
|
) shift_req_dpi (
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.clk (clk),
|
.clk (clk),
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.reset (fdiv_reset[i]),
|
.reset (reset),
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.enable (enable),
|
.enable (enable),
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.data_in (r),
|
.data_in (r),
|
||||||
.data_out (result[i])
|
.data_out (result[i])
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|||||||
@@ -39,6 +39,18 @@ module VX_fp_fma #(
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wire stall = ~ready_out && valid_out;
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wire stall = ~ready_out && valid_out;
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wire enable = ~stall;
|
wire enable = ~stall;
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`ifndef VERILATOR
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wire [LANES-1:0] fma_reset;
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VX_reset_relay #(
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.DEPTH (LANES > 1),
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.NUM_NODES (LANES)
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) reset_relay (
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.clk (clk),
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.reset (reset),
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.reset_o (fma_reset)
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|
);
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`endif
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for (genvar i = 0; i < LANES; i++) begin
|
for (genvar i = 0; i < LANES; i++) begin
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reg [31:0] a, b, c;
|
reg [31:0] a, b, c;
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@@ -86,7 +98,7 @@ module VX_fp_fma #(
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`else
|
`else
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acl_fmadd fmadd (
|
acl_fmadd fmadd (
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.clk (clk),
|
.clk (clk),
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||||||
.areset (reset),
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.areset (fma_reset[i]),
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.en (enable),
|
.en (enable),
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.a (a),
|
.a (a),
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.b (b),
|
.b (b),
|
||||||
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|||||||
@@ -32,6 +32,7 @@ module VX_fp_sqrt #(
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|||||||
wire stall = ~ready_out && valid_out;
|
wire stall = ~ready_out && valid_out;
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||||||
wire enable = ~stall;
|
wire enable = ~stall;
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||||||
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`ifndef VERILATOR
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wire [LANES-1:0] fsqrt_reset;
|
wire [LANES-1:0] fsqrt_reset;
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VX_reset_relay #(
|
VX_reset_relay #(
|
||||||
.DEPTH (LANES > 1),
|
.DEPTH (LANES > 1),
|
||||||
@@ -41,6 +42,7 @@ module VX_fp_sqrt #(
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|||||||
.reset (reset),
|
.reset (reset),
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||||||
.reset_o (fsqrt_reset)
|
.reset_o (fsqrt_reset)
|
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);
|
);
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||||||
|
`endif
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||||||
for (genvar i = 0; i < LANES; i++) begin
|
for (genvar i = 0; i < LANES; i++) begin
|
||||||
`ifdef VERILATOR
|
`ifdef VERILATOR
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@@ -58,7 +60,7 @@ module VX_fp_sqrt #(
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|||||||
.RESETW (1)
|
.RESETW (1)
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||||||
) shift_req_dpi (
|
) shift_req_dpi (
|
||||||
.clk (clk),
|
.clk (clk),
|
||||||
.reset (fsqrt_reset[i]),
|
.reset (reset),
|
||||||
.enable (enable),
|
.enable (enable),
|
||||||
.data_in (r),
|
.data_in (r),
|
||||||
.data_out (result[i])
|
.data_out (result[i])
|
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