rtl refactoring
This commit is contained in:
@@ -20,7 +20,9 @@ module VX_back_end #(
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VX_frE_to_bckE_req_if bckE_req_if,
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VX_wb_if writeback_if,
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VX_warp_ctl_if warp_ctl_if
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VX_warp_ctl_if warp_ctl_if,
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output wire ebreak
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);
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VX_wb_if wb_temp_if();
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@@ -69,6 +71,8 @@ module VX_back_end #(
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.gpr_stage_delay (gpr_stage_delay)
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);
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assign ebreak = exec_unit_req_if.is_etype && (| exec_unit_req_if.valid);
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VX_lsu_unit lsu_unit (
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.clk (clk),
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.reset (reset),
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@@ -81,14 +85,14 @@ module VX_back_end #(
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);
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VX_exec_unit exec_unit (
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.clk (clk),
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.reset (reset),
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.clk (clk),
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.reset (reset),
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.exec_unit_req_if(exec_unit_req_if),
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.inst_exec_wb_if (inst_exec_wb_if),
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.jal_rsp_if (jal_rsp_if),
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.branch_rsp_if (branch_rsp_if),
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.delay (exec_delay),
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.no_slot_exec (no_slot_exec)
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.inst_exec_wb_if(inst_exec_wb_if),
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.jal_rsp_if (jal_rsp_if),
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.branch_rsp_if (branch_rsp_if),
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.delay (exec_delay),
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.no_slot_exec (no_slot_exec)
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);
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VX_gpu_inst gpu_inst (
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@@ -119,6 +123,6 @@ module VX_back_end #(
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.no_slot_mem (no_slot_mem),
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.no_slot_exec (no_slot_exec),
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.no_slot_csr (no_slot_csr)
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);
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);
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endmodule
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