cache request interfaces update
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@@ -26,11 +26,8 @@ module VX_pipeline #(
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// Icache core request
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output wire icache_req_valid,
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output wire icache_req_rw,
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output wire [3:0] icache_req_byteen,
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output wire [29:0] icache_req_addr,
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output wire [31:0] icache_req_data,
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output wire [`ICORE_TAG_WIDTH-1:0] icache_req_tag,
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output wire [`ICORE_TAG_WIDTH-1:0] icache_req_tag,
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input wire icache_req_ready,
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// Icache core response
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@@ -63,71 +60,66 @@ module VX_pipeline #(
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// Dcache request
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VX_cache_core_req_if #(
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VX_dcache_core_req_if #(
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.NUM_REQS(`NUM_THREADS),
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.WORD_SIZE(4),
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.CORE_TAG_WIDTH(`DCORE_TAG_WIDTH),
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.CORE_TAG_ID_BITS(`DCORE_TAG_ID_BITS)
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) core_dcache_req_if();
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) dcache_core_req_if();
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assign dcache_req_valid = core_dcache_req_if.valid;
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||||
assign dcache_req_rw = core_dcache_req_if.rw;
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||||
assign dcache_req_byteen = core_dcache_req_if.byteen;
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||||
assign dcache_req_addr = core_dcache_req_if.addr;
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||||
assign dcache_req_data = core_dcache_req_if.data;
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||||
assign dcache_req_tag = core_dcache_req_if.tag;
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assign core_dcache_req_if.ready = dcache_req_ready;
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||||
assign dcache_req_valid = dcache_core_req_if.valid;
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||||
assign dcache_req_rw = dcache_core_req_if.rw;
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||||
assign dcache_req_byteen = dcache_core_req_if.byteen;
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||||
assign dcache_req_addr = dcache_core_req_if.addr;
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||||
assign dcache_req_data = dcache_core_req_if.data;
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||||
assign dcache_req_tag = dcache_core_req_if.tag;
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assign dcache_core_req_if.ready = dcache_req_ready;
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//
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// Dcache response
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//
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VX_cache_core_rsp_if #(
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VX_dcache_core_rsp_if #(
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.NUM_REQS(`NUM_THREADS),
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.WORD_SIZE(4),
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||||
.CORE_TAG_WIDTH(`DCORE_TAG_WIDTH),
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||||
.CORE_TAG_ID_BITS(`DCORE_TAG_ID_BITS)
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||||
) core_dcache_rsp_if();
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||||
) dcache_core_rsp_if();
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||||
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||||
assign core_dcache_rsp_if.valid = dcache_rsp_valid;
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||||
assign core_dcache_rsp_if.data = dcache_rsp_data;
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||||
assign core_dcache_rsp_if.tag = dcache_rsp_tag;
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||||
assign dcache_rsp_ready = core_dcache_rsp_if.ready;
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||||
assign dcache_core_rsp_if.valid = dcache_rsp_valid;
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||||
assign dcache_core_rsp_if.data = dcache_rsp_data;
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||||
assign dcache_core_rsp_if.tag = dcache_rsp_tag;
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||||
assign dcache_rsp_ready = dcache_core_rsp_if.ready;
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//
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// Icache request
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//
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VX_cache_core_req_if #(
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.NUM_REQS(1),
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VX_icache_core_req_if #(
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||||
.WORD_SIZE(4),
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||||
.CORE_TAG_WIDTH(`ICORE_TAG_WIDTH),
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||||
.CORE_TAG_ID_BITS(`ICORE_TAG_ID_BITS)
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||||
) core_icache_req_if();
|
||||
) icache_core_req_if();
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||||
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||||
assign icache_req_valid = core_icache_req_if.valid;
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||||
assign icache_req_rw = core_icache_req_if.rw;
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||||
assign icache_req_byteen = core_icache_req_if.byteen;
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||||
assign icache_req_addr = core_icache_req_if.addr;
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||||
assign icache_req_data = core_icache_req_if.data;
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||||
assign icache_req_tag = core_icache_req_if.tag;
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||||
assign core_icache_req_if.ready = icache_req_ready;
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||||
assign icache_req_valid = icache_core_req_if.valid;
|
||||
assign icache_req_addr = icache_core_req_if.addr;
|
||||
assign icache_req_tag = icache_core_req_if.tag;
|
||||
assign icache_core_req_if.ready = icache_req_ready;
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||||
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//
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||||
// Icache response
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//
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||||
VX_cache_core_rsp_if #(
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||||
.NUM_REQS(1),
|
||||
VX_icache_core_rsp_if #(
|
||||
.WORD_SIZE(4),
|
||||
.CORE_TAG_WIDTH(`ICORE_TAG_WIDTH),
|
||||
.CORE_TAG_ID_BITS(`ICORE_TAG_ID_BITS)
|
||||
) core_icache_rsp_if();
|
||||
) icache_core_rsp_if();
|
||||
|
||||
assign core_icache_rsp_if.valid = icache_rsp_valid;
|
||||
assign core_icache_rsp_if.data = icache_rsp_data;
|
||||
assign core_icache_rsp_if.tag = icache_rsp_tag;
|
||||
assign icache_rsp_ready = core_icache_rsp_if.ready;
|
||||
assign icache_core_rsp_if.valid = icache_rsp_valid;
|
||||
assign icache_core_rsp_if.data = icache_rsp_data;
|
||||
assign icache_core_rsp_if.tag = icache_rsp_tag;
|
||||
assign icache_rsp_ready = icache_core_rsp_if.ready;
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||||
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//
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// CSR IO request
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@@ -183,8 +175,8 @@ module VX_pipeline #(
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`SCOPE_BIND_VX_pipeline_fetch
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.clk (clk),
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.reset (reset),
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||||
.icache_req_if (core_icache_req_if),
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||||
.icache_rsp_if (core_icache_rsp_if),
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||||
.icache_req_if (icache_core_req_if),
|
||||
.icache_rsp_if (icache_core_rsp_if),
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||||
.wstall_if (wstall_if),
|
||||
.join_if (join_if),
|
||||
.warp_ctl_if (warp_ctl_if),
|
||||
@@ -240,8 +232,8 @@ module VX_pipeline #(
|
||||
.perf_pipeline_if (perf_pipeline_if),
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||||
`endif
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||||
.dcache_req_if (core_dcache_req_if),
|
||||
.dcache_rsp_if (core_dcache_rsp_if),
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||||
.dcache_req_if (dcache_core_req_if),
|
||||
.dcache_rsp_if (dcache_core_rsp_if),
|
||||
|
||||
.csr_io_req_if (csr_io_req_if),
|
||||
.csr_io_rsp_if (csr_io_rsp_if),
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||||
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