Fixed two variabled driving the dram_delay signal
This commit is contained in:
@@ -51,7 +51,7 @@ void Simulator::ibus_driver() {
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}
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}
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}
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}
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if (vortex_->I_dram_req && !I_dram_stalled_) {
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if (vortex_->I_dram_req && !dram_stalled_) {
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// std::cout << "Icache Dram Request received!\n";
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// std::cout << "Icache Dram Request received!\n";
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if (vortex_->I_dram_req_read) {
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if (vortex_->I_dram_req_read) {
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// std::cout << "Icache Dram Request is read!\n";
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// std::cout << "Icache Dram Request is read!\n";
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@@ -102,17 +102,17 @@ void Simulator::ibus_driver() {
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vortex_->I_dram_fill_rsp_addr = 0;
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vortex_->I_dram_fill_rsp_addr = 0;
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}
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}
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#ifdef ENABLE_DRAM_STALLS
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// #ifdef ENABLE_DRAM_STALLS
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I_dram_stalled_ = false;
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// I_dram_stalled_ = false;
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if (0 == (total_cycles_ % DRAM_STALLS_MODULO)) {
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// if (0 == (total_cycles_ % DRAM_STALLS_MODULO)) {
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I_dram_stalled_ = true;
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// I_dram_stalled_ = true;
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} else
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// } else
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if (I_dram_req_vec_.size() >= DRAM_RQ_SIZE) {
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// if (I_dram_req_vec_.size() >= DRAM_RQ_SIZE) {
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I_dram_stalled_ = true;
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// I_dram_stalled_ = true;
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}
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// }
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#endif
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// #endif
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vortex_->dram_req_delay = I_dram_stalled_;
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// vortex_->dram_req_delay = I_dram_stalled_;
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}
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}
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#endif
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#endif
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@@ -132,16 +132,6 @@ void Simulator::dbus_driver() {
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}
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}
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}
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}
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#ifdef ENABLE_DRAM_STALLS
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dram_stalled_ = false;
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if (0 == (total_cycles_ % DRAM_STALLS_MODULO)) {
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dram_stalled_ = true;
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} else
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if (dram_req_vec_.size() >= DRAM_RQ_SIZE) {
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dram_stalled_ = true;
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}
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#endif
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#ifdef USE_MULTICORE
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#ifdef USE_MULTICORE
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if (vortex_->out_dram_req && !dram_stalled_) {
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if (vortex_->out_dram_req && !dram_stalled_) {
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@@ -286,6 +276,16 @@ void Simulator::step() {
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vortex_->clk = 1;
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vortex_->clk = 1;
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vortex_->eval();
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vortex_->eval();
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#ifdef ENABLE_DRAM_STALLS
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dram_stalled_ = false;
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if (0 == (total_cycles_ % DRAM_STALLS_MODULO)) {
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dram_stalled_ = true;
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} else
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if (dram_req_vec_.size() >= DRAM_RQ_SIZE) {
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dram_stalled_ = true;
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}
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#endif
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#ifndef USE_MULTICORE
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#ifndef USE_MULTICORE
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ibus_driver();
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ibus_driver();
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#endif
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#endif
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